The role is RTL Design Engineer focused on RTL design using Verilog HDL, implementation, and debugging, with collaboration across teams for physical implementation.
This position is based in Markham, ON.
The salary is listed as $80.00–$85.00 per hour.
A Master's or Bachelor's degree in Computer Engineering is required.
The role expects 10 years plus of professional experience.
Responsibilities include RTL design using Verilog HDL, comprehension of SOC-level architectural specifications, drafting micro-architecture guidelines, design linking and simulation, and collaboration with synthesis and backend teams.
InfoTree is hiring for a full-time RTL Design Engineer role in Markham, ON.
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